2018年7月
Maximizing Energy Efficiency of On-Chip Caches Exploiting Hybrid Memory Structure
28th International Symposium on Power and Timing Modeling, Optimization and Simulation (PATMOS)
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- 開始ページ
- 237
- 終了ページ
- 242
- 記述言語
- 掲載種別
- 研究論文(国際会議プロシーディングス)
- DOI
- 10.1109/PATMOS.2018.8464141
- リンク情報
- ID情報
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- DOI : 10.1109/PATMOS.2018.8464141
- ISBN : 9781538663653
- DBLP ID : conf/patmos/XuSIO18